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[教程] ip 核生成 rom +questasim仿真注意事项

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    发表于 6 天前 |显示全部楼层
    IP 核生成 ROM 步骤1:Tools --> MegaWizard Plug-In Manager  

    TIM截图20170717142528.png


    步骤2:Create a new custom megafuction variation

    TIM截图20170717142547.png


    步骤3:Memory Compier --> ROM --> Verilog HDL --> 自定义名称      

    TIM截图20170717142605.png


    步骤4:

    TIM截图20170717142619.png


    步骤5:

    TIM截图20170717142627.png


    步骤6:

    TIM截图20170717142642.png


    步骤7:

    TIM截图20170717142811.png


    questasim仿真注意问题1、仿真时要注意是否有 altera_mf 库文件,否则会报错。
         Module 'altsyncram' is not define
         解决方案:
    • 下载 altera_mf 库文件
    • 仿真时将 altera_mf.v 与其他文件一起加入到 project 中。
    2、要将 .mif 文件放在仿真工程目录下,即与 .mpf 文件在一起,否则将不会有数据输出。
    TIM截图20170717142850.png



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