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不容易啊,DSP+FPGA+千兆网的板子的硬件终于调完了

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  • TA的每日心情

    2021-12-24 16:56
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    [LV.9]以坛为家II

    发表于 2015-5-11 11:01:56 | 显示全部楼层 |阅读模式
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    大概有一个星期吧,断断续续的。
    现在来说说存在的问题:
    FPGA:
    1.FLASH的某个脚的线少走了0.5mm,导致不通,耗费了半天才检查出来
    DSP:
    1.FLASH的驱动不兼容,导致没法下载程序,耗费了3天多
    2.NMI中断引脚默认为低,焊接的时候拉高了,导致程序没法运行,耗费了1天多
    千兆网:
    1.PHY部分的LDO电源没处理好,导致波形不好,耗费3天多
    2.焊接有个以太网引脚虚焊,导致网络连接不稳定,耗费1天多
    3.千兆mac的读写,因为跳线搞错,导致读出的数据异常,耗费2天多


    都是血泪史啊。


    现在完成的功能有
    1.DSP能够读写FPGA模拟的外部并行总线数据
    2.DSP能够配置网络为1000M
    3.DSP能够从外部FLASH启动
    4.1000M网络连接能够稳定连接,不断开


    就这些吧,过两天安排出差,还得准备点出差用的东西,回来继续调试软件。
    DSP控制的千兆网应该比FPGA控制的千兆网要容易弄些。
    下面来上个图:


    千兆网板子

    千兆网板子
    IMAG1047.jpg
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  • TA的每日心情
    奋斗
    2021-11-12 08:38
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    [LV.7]常住居民III

    发表于 2015-5-11 11:14:41 | 显示全部楼层
    我还以为需要一大堆东西,然后至少4层板呢。。。
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  • TA的每日心情

    2021-12-24 16:56
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    [LV.9]以坛为家II

     楼主| 发表于 2015-5-11 11:24:42 | 显示全部楼层
    zfz0122 发表于 2015-5-11 11:14
    我还以为需要一大堆东西,然后至少4层板呢。。。

    其实最好是4层板。因为电源部分处理起来太特么恼火了。而且,电流600多ma,地平面也坑坑洼洼的。4层,这些问题就都解决了。
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    该用户从未签到

    发表于 2015-5-11 13:24:50 | 显示全部楼层
    等楼主回来更新
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  • TA的每日心情
    开心
    2016-3-27 09:49
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    [LV.8]以坛为家I

    发表于 2015-5-11 14:02:28 | 显示全部楼层
    顶楼主,请问为什么要用DSP和FPGA呢,只用一个不行吗
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  • TA的每日心情
    开心
    2019-6-24 16:41
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    [LV.9]以坛为家II

    发表于 2015-5-11 17:25:02 | 显示全部楼层
    一般都是四层吧  
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  • TA的每日心情

    2021-12-24 16:56
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    [LV.9]以坛为家II

     楼主| 发表于 2015-5-11 19:47:36 来自手机 | 显示全部楼层
    feiting94 发表于 2015-5-11 14:02
    顶楼主,请问为什么要用DSP和FPGA呢,只用一个不行吗

    可以只用一个的,不过想验证下fpga和dsp分别控制千兆网的速度和难度。而且,按照设计,这俩芯片有分工的,控制这块主要让dsp做,io高速处理由fpga做。方便用在以后项目的初步验证。
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  • TA的每日心情

    2021-12-24 16:56
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     楼主| 发表于 2015-5-11 19:48:16 来自手机 | 显示全部楼层
    outstanding1573 发表于 2015-5-11 17:25
    一般都是四层吧

    是的,不过为了节约成本,暂时木有做四层
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    2019-3-18 14:51
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    [LV.Master]伴坛终老

    发表于 2015-5-11 21:36:01 | 显示全部楼层
    mark PHY和MAC用的啥
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    2021-12-24 16:56
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     楼主| 发表于 2015-5-12 00:38:09 | 显示全部楼层
    aaaalook 发表于 2015-5-11 21:36
    mark PHY和MAC用的啥

    MAC=AX88180
    PHY=RTL8211E
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