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[原创] 锆石 A4】2输入与非门程序设计

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    [LV.10]以坛为家III

    发表于 2016-8-24 22:22:26 |显示全部楼层
    接上一篇帖子
    锆石 A4 FPGA开发板-【锆石 A4】2选1数据选择器设计-爱板网论坛 - 电子工程师学习交流园地 http://www.eeboard.com/bbs/thread-48877-1-1.html
    之前通过原理图完成2输入与非门设计,下面直接使用Verilog语言完成设计。
    接下来开始第一个实例,新建工程,选择目录,器件,“finish”完成。使用Verilog设计文件,file下新建Verilog设计文件,程序编辑如下
    4.JPG

    编译通过,分析综合,有一个逻辑单元,3个管脚
    3.JPG

    新建波形文件,设置激励输入信号
    6.JPG

    功能仿真和时序仿真,不知道为什么时序仿真我这边出来无延迟
    7.JPG

    引脚分配
    8.JPG

    原理图设计见
    锆石 A4 FPGA开发板-锆石 A4】2输入与非门设计-爱板网论坛 - 电子工程师学习交流园地 http://www.eeboard.com/bbs/thread-48849-1-1.html
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