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[原创] 【 锆石 A4】2输入与非门程序设计

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    [LV.9]以坛为家II

    发表于 2016-8-26 00:23:49 |显示全部楼层
    接上一篇帖子
    锆石 A4 FPGA开发板-锆石 A4】2输入与非门程序设计-爱板网论坛 - 电子工程师学习交流园地 http://www.eeboard.com/bbs/thread-48918-1-1.html
    接下来开始第一个实例,新建工程,选择目录,器件,“finish”完成使用Verilog设计文件,file下新建.v设计文件,程序如下如下
    这次采用不同描述方式完成逻辑电路设计
    结构级方式描述2选1数选器
    1. module MUX2_1(
    2. P0,
    3. P1,
    4. S,
    5. F
    6. );
    7. input P0,P1,S;
    8. output F;
    9. wire not_S,andcntrl1,andcntrl2;

    10. not U1 (not_S,S);
    11. and U2 (andcntrl1,P0,not_S),
    12.          U3 (andcntrl2,P1,S);
    13. or U4 (F,andcntrl1,andcntrl2);
    14. endmodule
    复制代码
    数据流方式描述2选1数选器
    1. module mytest(
    2. P0,
    3. P1,
    4. S,
    5. F
    6. );
    7. input P0,P1,S;
    8. output F;

    9. assign F=~S&P0|S&~P1;
    10. endmodule
    复制代码
    采用行为描述方法描述2选1数选器
    1. module MUX2_1(
    2. P0,
    3. P1,
    4. S,
    5. F
    6. );
    7. input P0,P1,S;
    8. output F;
    9. reg F;

    10. always@ (P0 or P1 or S)
    11.         begin
    12.                 if(S==1'b0) F=P0;
    13.                 else F=P1;
    14.         end
    15. endmodule      
    复制代码
    以数据流方式为例
    保存,编译如下
    3.JPG

    新建波形文件,添加激励信号保存后,如下
    6.JPG

    功能仿真和时序仿真
    4.JPG

    原理图设计见
    锆石 A4 FPGA开发板-【锆石 A4】2选1数据选择器设计-爱板网论坛 - 电子工程师学习交流园地 http://www.eeboard.com/bbs/thread-48877-1-1.html
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    发表于 2016-8-26 13:07:06 |显示全部楼层
    suoma最近在玩fpga啊
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    发表于 2016-8-26 22:12:00 |显示全部楼层
    halo501 发表于 2016-8-26 13:07
    suoma最近在玩fpga啊

    学习一下,混口饭吃
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    发表于 2016-9-1 16:46:53 |显示全部楼层
    生成的RTL门级电路
    4.JPG

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    发表于 2016-9-1 16:58:41 |显示全部楼层
    使用technology map viewer后的结果
    6.JPG

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    发表于 2016-9-1 19:48:45 |显示全部楼层
    注意题目应该是——2选1数选器程序设计
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