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FPGA altera 时钟约束资料

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shanghairen
  • TA的每日心情
    开心
    2014-4-21 09:44

    • 签到天数: 26 天

    连续签到: 1 天

    [LV.4]偶尔看看III
    发表于 2017-7-19 09:45:50 | 显示全部楼层 |阅读模式
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    在设计以太网中继器时，因为没有配置时钟约束，导致中继器工作不正常。

    后面根据手册配置时钟约束解决了此问题。

    Quartus II TimeQuest时序分析器说明书.pdf (397.14 KB, 下载次数: 17)

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    expertss
  • TA的每日心情
    开心
    2017-7-21 12:58

    • 签到天数: 907 天

    连续签到: 2 天

    [LV.10]以坛为家III
    发表于 2017-7-20 14:48:37 | 显示全部楼层
    挺好的资料
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