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[教程] 【转】fpga硬件调试vivado——mark_debug(中)

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翰林

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    [LV.7]常住居民III

    发表于 2017-7-21 09:53:06 |显示全部楼层
    Vivado和ISE相比ChipScope已经大幅改变,很多人都不习惯。在ISE中称为ChipScope而Vivado中就称为in system debug。下面就介绍Vivado中如何使用debug工具。
    Debug分为3个阶段:
    1. 探测信号:在设计中标志想要查看的信号
    2. 布局布线:给包含了debug IP的设计布局布线
    3. 分析:上板看信号

    一 探测信号
    探测信号有2种方法一种是直接在HDL源代码中用(*mark_debug = “true”*)标识出要探测的信号 另一种是 在综合过后的网表文件中添加标志。

    1 .在HDL源代码中添加标志
    8852-18729-1.jpg


    然后点击open Synthesized Design
    8852-18730-2.jpg

    然后点击Tools-> Set Up Debug
    8852-18731-3.jpg

    点击 Next
    8852-18732-4.jpg


    点击Add/Remove Nets
    8852-18733-5.jpg

    点击find会出来所有信号。如果需要添加debug的信号,从左边框中选择所需信号,点击按 钮加到右边来。如果需要去除不需要的debug信号,从右边框中选择所需信号,点击按钮就 去除了。选好信号之后,在右下角点击Ok按钮。
    8852-18734-6.jpg


    在此框中为所有debug信号选择时钟域,选择debug信号,右键选择Select Clock Domain。注意每一个时钟域对应一个单独的ILA 2.0core。
    8852-18735-7.jpg

    在此框中选择所需时钟,点击ok
    8852-18736-8.jpg

    点击next
    8852-18737-9.jpg


    然后继续下面的Implement 流程
    8852-18738-10.jpg

    点击Save保存修改后的工程
    8852-18739-11.jpg


    后面像以前一样等工程跑结束。
    2.在网表文件中添加标志
    网表文件添加标志,第一步也是打开综合后设计。如下图所示

    8852-18740-12.jpg


    第二步是打开debug窗口
    8852-18741-13.jpg


    Open synthesized Design之后,有2种方法来标志debug信号
    (1) 第一种方法是在Netlist窗口中选择信号,右键点击Mark Debug
    8852-18742-14.jpg

    (2) 第二种方法是在Tools中选择Setup Debug 推荐使用此方法
    8852-18743-15.jpg

    然后和前面一样继续跑工程。
    二 上板调试
    上板的时候选择Open hardware session ,然后Open a new hardware target


    8852-18744-16.jpg

    选择next
    8852-18745-17.jpg


    选择next
    8852-18746-18.jpg


    选择Next
    8852-18747-19.jpg


    选择FPGA来配置文件
    8852-18748-20.jpg


    注意移到另一台电脑看debug信号时,必须将debug_nets.ltx 文件和bit文件一起移过去。如下图红框所示:

    8852-18749-21.jpg


    如果需要设置触发条件,选择Windows –> Debug Probes
    8852-18750-22.jpg


    在Debug Probe窗口中选择需要设置的信号,然后设置触发条件。在Trigger Pos中可以设置抓取到触发信号跳变前N个时钟周期可以被抓到
    8852-18751-23.jpg

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